http://www.www.datasheet4u.com

900,000+ Datasheet PDF Search and Download

Datasheet4U offers most rated semiconductors datasheets pdf





Micron
Micron

MT49H8M32 Datasheet Preview

MT49H8M32 Datasheet

1 Meg x 32 x 8 Banks Reduced Latency DRAM

No Preview Available !

MT49H8M32 pdf
256Mb: x16, x32 2.5V VEXT, 1.8V VDD, 1.8V VDDQ, RLDRAM
Features
Reduced Latency DRAM (RLDRAM®)
MT49H8M32 – 1 Meg x 32 x 8 Banks
MT49H16M16 – 2 Meg x 16 x 8 Banks
For the latest data sheet, refer to Micron’s Web site: www.micron.com/products/dram/rldram/
Features
• Organization: 8 Meg x 32, 16 Meg x 16 in 8 banks
• Cyclic bank addressing for maximum data
bandwidth
• Non multiplexed addresses
• Non interruptible sequential burst of two (2-bit
prefetch) and four (4-bit prefetch) DDR
• Up to 600 Mb/sec/pin data rate
• Programmable READ latency (RL) of 5-6
• Data valid signal (DVLD) activated as read data is
available
• Data mask signals (DM0/DM1) to mask first and
• second part of write data burst
• IEEE 1149.1 compliant JTAG boundary scan
• 2.5V VEXT, 1.8V VDD, 1.8V VDDQ I/O
• Pseudo-HSTL 1.8V I/O Supply
• Internal auto precharge
• Refresh requirements: 32ms at 95°C case
temperature (8K refresh for each bank, 64K refresh
command must be issued in total each 32ms)
• 144-pin, 11mm x 18.5mm µBGA/FBGA package
Options
Marking
• Clock Cycle Timing
3.3ns (300 MHz)
4ns (250 MHz)
5ns (200 MHz)
• Configuration
8 Meg x 32 (1 Meg x 32 x 8 banks)
16 Meg x 16 (2 Meg x 16
-33
-42
-5
MT49H8M32
MT49H16M16
x 8 banks)
• Operating temperature
Commercial (0°C to +95°C)
Industrial (TC = –40°C to +95°C)
Industrial (TA = –40°C to +85°C)
• Package
144-ball, µBGA
144-ball, µBGA (Pb-Free)
144-ball, FBGA
144-ball, FBGA (Pb-Free)
None
IT
FM
BM1
HU3
HT1,3
Notes: 1. Contact factory for availability.
2. End of life.
3. The FBGA package is being phased out.
Figure 1: 144-Ball µBGA
Table 1: Valid Part Numbers
Part Number
MT49H8M32HU-xx
MT49H16M16HU-xx
Description
8 Meg x 32
16 Meg x 16
General Description
The Micron® 256Mb reduced latency DRAM
(RLDRAM®) contains 8 banks x32Mb of memory
accessible with 32-bit or 16-bit I/Os in a double data
rate (DDR) form at where the data is provided and syn-
chronized with a differential echo clock signal.
RLDRAM does not require row/column address multi-
plexing and is optimized for fast random access and
high-speed bandwidth.
RLDRAM is designed for high bandwidth communica-
tion data storage—telecommunications, networking,
and cache applications, etc.
pdf: 09005aef81121545/source: 09005aef810c0ffc
256Mbx16x32RLDRAM_1.fm - Rev I 4/08 EN
1 Micron Technology, Inc., reserves the right to change products or specifications without notice.
©2001 Micron Technology, Inc. All rights reserved.
Products and specifications discussed herein are subject to change by Micron without notice.



Micron
Micron

MT49H8M32 Datasheet Preview

MT49H8M32 Datasheet

1 Meg x 32 x 8 Banks Reduced Latency DRAM

No Preview Available !

MT49H8M32 pdf
256Mb: x16, x32 2.5V VEXT, 1.8V VDD, 1.8V VDDQ, RLDRAM
Table of Contents
Table of Contents
Features . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .1
General Description . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .1
Functional Block Diagrams. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .5
Ball Assignments and Descriptions. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .7
Commands . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .9
Initialization . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .12
MODE REGISTER SET Command (MRS). . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .14
Configuration Table . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .16
Write Basic Information. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .16
Read Basic Information . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .21
AUTO REFRESH Command (AREF) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .26
IEEE 1149.1 Serial Boundary Scan (JTAG) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .27
Disabling The JTAG Feature . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .27
Test Access Port (TAP) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .27
Test Clock (TCK) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .27
Test Mode Select (TMS) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .27
Test Data-in (TDI) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .27
Test Data-out (TDO) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .28
Performing A Tap RESET . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .28
Tap Registers . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .28
Instruction Register . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .28
Bypass Register . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .29
Boundary Scan Register . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .29
Identification (ID) Register. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .29
Tap Instruction Set . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .30
Overview. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .30
EXTEST . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .30
IDCODE . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .30
SAMPLE/PRELOAD . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .30
BYPASS . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .31
Reserved for Future Use . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .31
Electrical Characteristics . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .35
Recommended DC Operation Ranges. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .35
Package Dimensions . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .39
pdf: 09005aef81121545/source: 09005aef810c0ffc
256M_16_32_RLDRAMTOC.fm - Rev I 4/08 EN
2 Micron Technology, Inc., reserves the right to change products or specifications without notice.
©2001 Micron Technology, Inc. All rights reserved


Part Number MT49H8M32
Description 1 Meg x 32 x 8 Banks Reduced Latency DRAM
Maker Micron
Total Page 30 Pages
PDF Download
MT49H8M32 pdf
Download PDF File
[partsNo] view html
View PDF for Mobile






Related Datasheet

1 MT49H8M32 1 Meg x 32 x 8 Banks Reduced Latency DRAM Micron
Micron
MT49H8M32 pdf
2 MT49H8M36 8 Meg x 36 x 8 Banks CIO RLDRAM 2 Micron Technology
Micron Technology
MT49H8M36 pdf






Part Number Start With

0    1    2    3    4    5    6    7    8    9    A    B    C    D    E    F    G    H    I    J    K    L    M    N    O    P    Q    R    S    T    U    V    W    X    Y    Z

site map

webmaste! click here

contact us

Buy Components